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ラティスの设计ツールとIPはお客様の継続的なイノベーションのために提供されています。大量生产の携帯电话であれ最先端の通信インフラ机器であれ，こうした使いやすいツールとIPは独自のアイディアを竞合他社に先駆けて制品化して市场に投入するための强力な支援となります。
検証済みで再利用可能な機能を用いて設計労力を軽減しましょう。これら実績のあるIPコアはラティスのデバイス・アーキテクチャに最適化されており,最新デバイスの特長をフルに引き出す高速動作かつリソース使用効率の高い結果を得ることができます。
晶格FPGAファミリ用の先進の設計ツールです。使いやすいGUIでデザインの推敲に優れ,最適化された設計フローや充実したtclスクリプティングなど,多くの機能性を備える钻石の設計プロセスにアップグレードしましょう。
iCE40 UltraPlus対応のフル機能FPGA設計ツールスイートはエッジアプリケーション向けに最適化されており,統合された設計フレームワークと圧倒的な使い易さで予測可能な設計コンバージェンスを実現します
この使いやすい设计ツールはお客様がコストと消费电力要件，そして市场投入までの期间を満たすための支援をします.iCEcube2设计ツールは小论理规模FPGAのiCE40ファミリに対応します。
的ispLEVER经典はラティスのCPLDとマチュアPLD制品用の设计环境です。コンセプトからデバイス书き込みファイルの生成まで，设计プロセスの全ての作业を実行できます。
ニューラルネットワークNNコンパイラは，TensorFlowと来自Caffeからの出力を取り込み，ラティスCNNとBNNアクセラレータIPでの実装向けにコンパイルします
莱迪思FPGAにLatticeMico32的ソフトプロセッサおよびLatticeMico8ソフトマイコンと，ペリフェラル回路の実装に用います.LatticeMico系统は，组み込みソフトウェア构筑用に业界で标准的に用いられているオープンソースの开発·アプリケーション·フレームワークであるEclipse中C / C ++开発ツール（CDT）环境をベースにしています。
プラットホーム·マネージャとパワーマネージャ，および的ispClockの各デバイスに対応する设计およびシミュレーション环境です。
プログラマーはラティス全てのデバイスのプログラミング用で,ラティスDimaondに搭載されています
はLatticeECP3の并行转换器デバッグを支援します