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  • DDR3 SDRAM控制器

    IP核

    DDR3 SDRAM控制器

    与行业标准的DDR3内存（JESD79-3标准）通用完整的内存控制器的接口，并提供了一个通用的命令接口
    LatticeECP3的，ECP5 / ECP5-5G，交联-NX
    连接IP套件，DDR 2/3/4 +，以太网IP套件，的PCIe IP套件，值IP套件，视频IP套件
    DDR3 SDRAM控制器
  • LPDDR3 SDRAM控制器

    IP核

    LPDDR3 SDRAM控制器

    通用存储器控制器与行业标准LPDDR3存储器设备和模块的接口与JESD-209.3规范合
    ECP5 / ECP5-5G
    连接IP套件，DDR 2/3/4 +，的PCIe IP套件，视频IP套件
    LPDDR3 SDRAM控制器
  • PCI Express端点核心

    IP核

    PCI Express端点核心

    提供了从电SERDES接口到事务层的PCI Express X1，X2或x4端点溶液
    ECP5 / ECP5-5G，的LatticeECP2 / M，LatticeECP3的，交联-NX
    总线控制器，连接IP套件，的PCIe，的PCIe IP套件
    PCI Express端点核心
  • 个PCI Express x1，x4的根联合体精简版IP核

    IP核

    个PCI Express x1，x4的根联合体精简版IP核

    提供了从电SERDES接口在PCIe协议栈中的X1根复合体溶液中，物理层，数据链路层和最小事务处理层
    ECP5 / ECP5-5G，LatticeECP3的，的LatticeECP2 / M
    连接IP套件，的PCIe，的PCIe IP套件
    个PCI Express x1，x4的根联合体精简版IP核
  • 散射收集DMA控制器

    IP核

    散射收集DMA控制器

    实现了一个可配置的，多通道的，符合WISHBONE-DMA控制器用分散 - 收集能力
    ECP5 / ECP5-5G，LatticeECP3的，的LatticeECP2 / M，的LatticeSC / M，的LatticeXP2，交联-NX
    总线控制器，连接IP套件，DMA，以太网IP套件，的PCIe IP套件
    散射收集DMA控制器
  • LPDDR SDRAM控制器

    IP核

    LPDDR SDRAM控制器

    通用内存控制器与行业标准的LPDDR内存设备接口/模块与JESD209B兼容
    MachXO2的
    DDR 2/3/4 +，的PCIe IP套件，值IP套件
    LPDDR SDRAM控制器
  • 32位PCI主/目标

    IP核

    32位PCI主/目标

    提供了一种可定制的64分之32位主/目标或目标的解决方案 - 修订2.2速度高达66MHz的
    的LatticeECP2 / M，的MachXO，的LatticeXP2，LatticeECP3的，MachXO2的
    总线控制器，PCI，的PCIe IP套件
    32位PCI主/目标
  • 32位PCI目标

    IP核

    32位PCI目标

    与PCI本地总线规范，修订版2.2速度高达66MHz的完全兼容
    的LatticeECP2 / M，的MachXO，的LatticeXP2，LatticeECP3的，MachXO2的
    总线控制器，PCI，的PCIe IP套件
    32位PCI目标
  • 64位PCI主/目标

    IP核

    64位PCI主/目标

    与PCI SIG 3.0完全兼容的速度高达66MHz的。定制的32/64位主/目标或目标溶液
    的LatticeSC / M，的LatticeECP2 / M，的LatticeXP2，LatticeECP3的
    总线控制器，PCI，的PCIe IP套件
    64位PCI主/目标
  • 64位PCI目标

    IP核

    64位PCI目标

    与PCI SIG 3.0完全兼容的速度高达66MHz的。定制的64分之32位。
    的LatticeSC / M，的LatticeECP2 / M，的LatticeXP2，LatticeECP3的
    总线控制器，PCI，的PCIe IP套件
    64位PCI目标
  • PHY接口的PCI Express - PIPE

    IP核

    PHY接口的PCI Express - PIPE

    PHY装置和用于PCI Express（PCIe）的应用程序的媒体访问（MAC）层之间的标准接口yabovip888
    LatticeECP3的，的LatticeECP2 / M
    的PCIe，的PCIe IP套件，PCS，SERDES
    PHY接口的PCI Express - PIPE
  • DDR SDRAM控制器 - 流水线

    IP核

    DDR SDRAM控制器 - 流水线

    通用内存控制器，与业界标准的DDR SDRAM接口
    LatticeECP3的，的LatticeXP2，MachXO2的，的LatticeECP2 / M
    DDR 2/3/4 +，以太网IP套件，的PCIe IP套件，值IP套件，视频IP套件
    DDR SDRAM控制器 - 流水线
  • DDR2 SDRAM控制器 - 流水线

    IP核

    DDR2 SDRAM控制器 - 流水线

    通用内存控制器，与业界标准的DDR2 SDRAM接口
    的LatticeECP2 / M，的LatticeXP2，LatticeECP3的，MachXO2的
    DDR 2/3/4 +，以太网IP套件，的PCIe IP套件，值IP套件，视频IP套件
    DDR2 SDRAM控制器 - 流水线
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