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  • CNN +加速器IP

    IP核心

    CNN +加速器IP

    用CNNS实现超低功耗AI解决方案。配置多达16位宽。适用于格子神经网络编译器软件工具。
    CNN +加速器IP
  • FPD-LINK接收器

    IP核心

    FPD-LINK接收器

    模块化MIPI / D-PHY IP - 将FPD-Link视频流转换为像素时钟域
    FPD-LINK接收器
  • FPD-LINK变送器

    IP核心

    FPD-LINK变送器

    模块化MIPI / D-PHY IP - 将像素数据流转换为FPD-Link视频流
    FPD-LINK变送器
  • Sublvds图像传感器接收器

    IP核心

    Sublvds图像传感器接收器

    模块化MIPI / D-PHY IP - 将Sublvds Image Sensor视频流转换为像素时钟域
    Sublvds图像传感器接收器
  • I3C主IP核心

    IP核心

    I3C主IP核心

    MIPI I3C规范之后的总线控制器。高达12.5 MHz推拉,旧版I2C支持,多主力功能,带内中断,热连接等亚搏国际网址
    I3C主IP核心
  • I3C从IP核心

    IP核心

    I3C从IP核心

    接口MIPI I3C规范。高达12.5 MHz推拉,旧版I2C支持,多主力功能,带内中断,热连接等亚搏国际网址
    I3C从IP核心
  • 三速以太网MAC核心IP

    IP核心

    三速以太网MAC核心IP

    在主处理器和以太网网络之间传输和接收数据。IEEE 802.3符合要求。亚搏国际网址支持10/100/1000操作。
    三速以太网MAC核心IP
  • GPIO IP核心

    IP核心

    GPIO IP核心

    通过点阵内存映射接口(LMMI)或高级外围总线接口(APB)检测和控制gpio。
    GPIO IP核心
  • SPI主IP核心

    IP核心

    SPI主IP核心

    与外部SPI从设备进行通信。可配置数据宽度,FIFO TX / RX深度,极性,时钟模式和内存接口。
    SPI主IP核心
  • SPI奴隶IP核心

    IP核心

  • I2C从IP核心

    IP核心

    I2C从IP核心

    接口到I2C总线。亚搏国际网址支持具有可编程SCL频率的7位和10位寻址模式。标准,快速和快速模式加支持 - 最多1 Mbit / s亚搏国际网址
    I2C从IP核心
  • I2C主IP核心

    IP核心

    I2C主IP核心

    控制I2C总线。亚搏国际网址支持具有可编程SCL频率的7位和10位寻址模式。标准,快速和快速模式加支持 - 最多1 Mbit / s亚搏国际网址
    I2C主IP核心
  • DDR3 PHY

    IP核心

    DDR3 PHY

    将DDR3内存控制器(MC)连接到DDR3存储器设备(JESD79-3)。包含依赖于FPGA DDR IO基元所需的所有逻辑
    DDR3 PHY
  • DDR3 SDRAM控制器

    IP核心

    DDR3 SDRAM控制器

    通用完整内存控制器与行业标准DDR3内存(JESD79-3标准)接口,并提供通用命令界面
    DDR3 SDRAM控制器
  • UART 16550 IP核心

    IP核心

    UART 16550 IP核心

    可配置的UART端口。与PC16550D兼容。7或8位数据宽,1,1.5,2个停止位f用于Tx。多个奇偶校验和波特率选项。
    UART 16550 IP核心
  • 颜色空间转换器(CSC)

    IP核心

    颜色空间转换器(CSC)

    免费IP核心 - 支持从8-1亚搏国际网址6位的颜色空间转换和相关编解码器功能,高达18位。RGB. ycbcr. CMYK和更多。
    颜色空间转换器(CSC)
  • PCI Express Endpoint Core

    IP核心

    PCI Express Endpoint Core

    提供从Electrical Serdes接口到事务层的PCI Express X1,X2或X4端点解决方案
    PCI Express Endpoint Core
  • PCI Express x1,x4根复合Lite IP核心

    IP核心

    PCI Express x1,x4根复合Lite IP核心

    从电SERDES接口、物理层、数据链路层和PCIe协议栈的最小事务层提供x1根复杂解决方案
    PCI Express x1,x4根复合Lite IP核心
  • FFT编译器

    IP核心

    FFT编译器

    可以配置为执行前进FFT,逆FFT(IFFT)或端口可选前进/逆FFT。高性能流和低资源突发模式。
    FFT编译器
  • FIR滤波器发生器

    IP核心

    FIR滤波器发生器

    高度可配置的多通道FIR滤波器。亚搏国际网址支持高达256个频道,每个通道都有2048个点击。输入和系数宽度为4到32位。
    FIR滤波器发生器
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