iCE40 UltraPlus型

改善连通性，增加大脑。生产准备，最低功率的ML/AI解决方案与灵活的接口。

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iCE40 UltraPlus型移动开发平台

iCE40 UltraPlus型白皮书：“这个行业案例为分布式异构处理”

低功耗连接和计算- 随着用于电力智能家庭，工厂和城市系统的复杂性不断上升的iCE40 FPGA UltraPlus型解决连接问题与各种各样的接口和协议，以及更高水平的智能化提供了低功耗的计算资源。

聪明的FPGA边缘- iCE40超微+ FPGA具有5k查找表(LUTs)，能够实现模式匹配所需的神经网络，始终在智能的边缘。经过最佳级能力的优化，设计人员可以消除与云智能相关的延迟，同时保持整个系统解决方案的成本较低。

灵活的方案选择- 多种封装，以适应广泛的应用需求。yabovip888从消费者和的IoT设备进行优化，以0.5mm的间距7×7毫米QFN成本优化的应用程序的超小型2.15 X2.50毫米WLCSP封装。yabovip888

特征

  • 灵活的逻辑架构，拥有2800或5280个4路输入，可定制的I/O，高达80千比特的嵌入式内存和1兆比特的嵌入式内存
  • 超低功率先进工艺，静态电流可低至75ua和1- 10ma的有源电流yabovip888
  • 高性能信号处理采用DSP块具有乘法和累加功能
  • 软神经网络IP和编译器，灵活的机器学习/ AI实施
  • FPGA设计工具，演示和参考设计启动设计
ACE 2017年入围奖

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家人表

iCE40 UltraPlus型设备选型指南
参数 UP3K UP5K
密度的LUT 2800 5280
NVCM 是的 是的
静态电流(uA)
 75 75
EBR RAM(来) 80 120
SPRAM（千位） 1024 1024
锁相环 1 1
I2C核心 2 2
SPI核心 2 2
振荡器(10 kHz) 1 1
振荡器（48 MHz）的 1 1
24马开车 3. 3.
500毫安开车 - -
16×16乘法和32位累加器块 4 8
PWM 是的 是的
0.4毫米间距总I / O +专用输入1,2
UP3K UP5K
30引脚WLCSP（2.15 X2.55毫米） 21 21
0.5毫米间距总I / O +专用输入1,2
UP3K UP5K
48针QFN (7 x 7毫米) - 39

1.总I / O包括的专用I / O
2.专用I / O被定义为被专用引脚，并且不能由用户逻辑配置后使用

示例解决方案

通过使用莱迪思IP和参考设计创造差异化的产品。

点击这里获取更多的IP和参考设计

二值化神经网络（BNN）加速器IP框图扩大图像

二值化神经网络（BNN）加速器IP

  • 就拿FPGA的并行处理能力的优势，实现机器学习算法。
  • 启用实现，必须在毫瓦范围功耗BNNs的。
关键词检测方框图扩大图像

关键短语检测 - 格印象之美

  • 使系统能够随时搜索使用数字麦克风输入关键短语。
  • 消耗不到1兆瓦的平均功率。
面部优先框图扩大图像

人脸检测

  • 与有源功率的始终开启的图像传感器，同时消耗小于1mW使人工智能。
  • 帧频和功耗可调，满足系统功耗要求。
信号聚集和解聚集扩大图像

单线聚合

  • 在一个单一的数据线聚合多个接口。
  • 单线速度高达7.5 Mbps。
  • 具有错误检测和重试功能的健壮协议。
iCE40超8到1麦克风聚合框图扩大图像

8：1麦克风聚合

  • 聚合8个PDM麦克风和在我连接到处理器2年代或SPI。
  • 启用对梁的智能音箱形成使用多个麦克风。

设计资源

知识产权和参考设计

通过使用预先测试的、可重用的功能来简化您的设计工作

应用笔记

学习如何从我们的FPGAs /开发板的阵容中获得最大的利益

软件

设计流程完整，使用方便

开发套件与板

我们的开发板和工具包帮助简化设计流程

编程硬件

就拿应变出在系统编程的和在电路重新配置我们的编程硬件

视频

UltraPlus济视频扩大图像

介绍iCE40 UltraPlus型

晶格扩展了其移动FPGA产品家族的iCE40超微加，提供了8倍的内存(1.1 Mbit RAM)，两倍的数字信号处理器块(8x dsp)，和改进的I/O比前几代。在本视频中，学习更多关于iCE40超微超能力，如驱动一个MIPI DSI显示器与集成的SRAM内存帧缓冲。

使用iCE40 ultra - plus进行人脸检测扩大图像

人脸检测演示

了解iCE40 UltraPlus型如何帮助您与人脸检测的使用神经网络的实现。

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iCE40 UltraPlus型荣获编辑选择奖，最具竞争力的FPGA产品扩大图像

2016中国电子市场编辑选择奖

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